seal 0.1.0

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Files changed (421) hide show
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  420. data/src/win32api.rb +29 -0
  421. metadata +563 -0
data/mpg123/src/libmpg123/dct64_neon.S ADDED
@@ -0,0 +1,297 @@
1
+ /*
2
+ dct64_neon: ARM NEON optimized dct64
3
+
4
+ copyright 1995-2010 by the mpg123 project - free software under the terms of the LGPL 2.1
5
+ see COPYING and AUTHORS files in distribution or http://mpg123.org
6
+ initially written by Taihei Monma
7
+ */
8
+
9
+ #include "mangle.h"
10
+
11
+ .text
12
+ ALIGN16
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+ costab_arm:
14
+ .word 1056974725
15
+ .word 1057056395
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+ .word 1057223771
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45
+ .word 1060439283
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49
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+
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+
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+
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+ vrev64.32 q1, q1
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114
+ vsub.f32 q8, q0, q1
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+
139
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169
+
170
+ vtrn.32 q0, q1
171
+ vtrn.32 q2, q3
172
+ vtrn.32 q4, q5
173
+ vtrn.32 q6, q7
174
+ vswp d1, d2
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+ vswp d5, d6
176
+ vswp d9, d10
177
+ vswp d13, d14
178
+
179
+ vshr.u64 d16, d1, #32
180
+ vshr.u64 d17, d3, #32
181
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182
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+ vadd.f32 d1, d1, d16
184
+ vadd.f32 d3, d3, d17
185
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186
+ vadd.f32 d7, d7, d19
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192
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+
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+ vadd.f32 q5, q5, q10
207
+ vadd.f32 q7, q7, q11
208
+
209
+ vshr.u64 d16, d4, #32
210
+ vshr.u64 d18, d12, #32
211
+ vext.8 q8, q2, q8, #8
212
+ vext.8 q9, q6, q9, #8
213
+ vadd.f32 q2, q2, q3
214
+ vadd.f32 q6, q6, q7
215
+ vadd.f32 q3, q3, q8
216
+ vadd.f32 q7, q7, q9
217
+
218
+ vrev64.32 q8, q4
219
+ vshr.u64 d19, d9, #32
220
+ vext.8 d17, d17, d16, #4
221
+ vswp d9, d10
222
+ vswp d13, d14
223
+ vtrn.32 q4, q5
224
+ vtrn.32 q6, q7
225
+ vmov d16, d9
226
+ vmov d18, d11
227
+
228
+ vadd.f32 q4, q6
229
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230
+ vadd.f32 q6, q8
231
+ vadd.f32 q7, q9
232
+
233
+ vmov.i32 q8, #0x4b000000
234
+ vorr.i32 q8, #0x00400000
235
+ vadd.f32 q0, q0, q8
236
+ vadd.f32 q1, q1, q8
237
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242
+ vadd.f32 q7, q7, q8
243
+ vshl.i32 q0, q0, #10
244
+ vshl.i32 q1, q1, #10
245
+ vshl.i32 q2, q2, #10
246
+ vshl.i32 q3, q3, #10
247
+ vshl.i32 q4, q4, #10
248
+ vshl.i32 q5, q5, #10
249
+ vshl.i32 q6, q6, #10
250
+ vshl.i32 q7, q7, #10
251
+ vqshrn.s32 d0, q0, #10
252
+ vqshrn.s32 d2, q1, #10
253
+ vqshrn.s32 d4, q2, #10
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255
+ vqshrn.s32 d8, q4, #10
256
+ vqshrn.s32 d10, q5, #10
257
+ vqshrn.s32 d12, q6, #10
258
+ vqshrn.s32 d14, q7, #10
259
+
260
+ mov r3, #32
261
+ vst1.16 {d0[1]}, [r0, :16], r3
262
+ vst1.16 {d12[3]}, [r0, :16], r3
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+ vst1.16 {d6[2]}, [r0, :16], r3
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+ vst1.16 {d2[2]}, [r0, :16], r3
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+ vst1.16 {d12[2]}, [r0, :16], r3
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+
279
+ vst1.16 {d0[1]}, [r1, :16], r3
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+ vst1.16 {d6[3]}, [r1, :16], r3
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+ vst1.16 {d14[3]}, [r1, :16]
295
+
296
+ vpop {q4-q7}
297
+ bx lr
data/mpg123/src/libmpg123/dct64_neon_float.S ADDED
@@ -0,0 +1,270 @@
1
+ /*
2
+ dct64_neon_float: ARM NEON optimized dct64 (float output version)
3
+
4
+ copyright 1995-2010 by the mpg123 project - free software under the terms of the LGPL 2.1
5
+ see COPYING and AUTHORS files in distribution or http://mpg123.org
6
+ initially written by Taihei Monma
7
+ */
8
+
9
+ #include "mangle.h"
10
+
11
+ .text
12
+ ALIGN16
13
+ costab_arm:
14
+ .word 1056974725
15
+ .word 1057056395
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+ .word 1057223771
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+ .word 1062657950
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+ .word 1060439283
45
+ .word 1060439283
46
+ .globl ASM_NAME(dct64_real_neon)
47
+ ASM_NAME(dct64_real_neon):
48
+ vpush {q4-q7}
49
+
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+ adr r3, costab_arm
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+
58
+ vrev64.32 q4, q4
59
+ vrev64.32 q5, q5
60
+ vrev64.32 q6, q6
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+ vswp d12, d13
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66
+
67
+ vsub.f32 q8, q0, q7
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+
80
+ vld1.32 {q12, q13}, [r3, :128]!
81
+ vld1.32 {q14, q15}, [r3, :128]
82
+
83
+ vrev64.32 q2, q2
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89
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90
+ vswp d14, d15
91
+
92
+ vsub.f32 q8, q0, q3
93
+ vsub.f32 q9, q1, q2
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+ vsub.f32 q10, q4, q7
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+ vadd.f32 q1, q1, q2
98
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99
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100
+ vmul.f32 q2, q8, q12
101
+ vmul.f32 q3, q9, q13
102
+ vmul.f32 q6, q10, q12
103
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104
+
105
+ vrev64.32 q1, q1
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+ vswp d2, d3
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111
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113
+
114
+ vsub.f32 q8, q0, q1
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+ vadd.f32 q0, q0, q1
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+
127
+ vdup.32 q12, d31[0]
128
+ vmov d31, d30
129
+
130
+ vswp d1, d2
131
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133
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+ vrev64.32 q1, q1
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138
+
139
+ vsub.f32 q8, q0, q1
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152
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+
170
+ vtrn.32 q0, q1
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+ vshr.u64 d16, d1, #32
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+ vshr.u64 d18, d5, #32
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+ vshr.u64 d19, d7, #32
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+ vadd.f32 d1, d1, d16
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185
+ vadd.f32 d5, d5, d18
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+ vadd.f32 d7, d7, d19
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+ vshr.u64 d20, d9, #32
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+ vshr.u64 d21, d11, #32
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+ vshr.u64 d22, d13, #32
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+ vshr.u64 d23, d15, #32
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+ vadd.f32 d9, d9, d20
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+ vadd.f32 d15, d15, d23
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+
196
+ vshr.u64 d16, d2, #32
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+ vshr.u64 d18, d6, #32
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209
+ vshr.u64 d16, d4, #32
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211
+ vext.8 q8, q2, q8, #8
212
+ vext.8 q9, q6, q9, #8
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214
+ vadd.f32 q6, q6, q7
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+
218
+ vrev64.32 q8, q4
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232
+
233
+ mov r3, #64
234
+ vst1.32 {d0[1]}, [r0, :32], r3
235
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243
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270
+ bx lr